Cadence collabora con TSMC per innovare la progettazione Mobile e HPC

Pubblicato il 7 maggio 2018

Cadence Design Systems annuncia l’ulteriore estensione della collaborazione con TSMC ai progetti FinFET a 5 e 7nm+ per piattaforme mobili e di elaborazione ad alte prestazioni (HPC). I tool digitali, di signoff e custom/analogici Cadence hanno ottenuto le più recenti omologazioni Design Rule (DRM) e SPICE per i processi TSMC a 5nm e a 7nm+. I relativi kit di progettazione (PDK) sono ora disponibili per il download.

In sintesi:

  • I tool digitali, di signoff e custom/analogici Cadence ottengono le più recenti omologazioni DRM e SPICE per le tecnologie di processo TSMC a 5nm e 7nm+
  • Le funzionalità digitali, di signoff e per IC custom/analogici migliorano la produttività dei progettisti che lavorano a 5nm e 7nm+
  • Il flusso di tool di caratterizzazione delle librerie appoggiano il processo a 5nm e 7nm+

 Cadence, inoltre, supporta la nuova tecnologia di packaging avanzato TSMC WoW

Cadence ha inoltre annunciato che la sua suite di tool digitali, di signoff e di progettazione per IC custom/analogici e per tecnologie avanzate di packaging IC supporta la nuova tecnologia di stacking Wafer-on-Wafer (WoW) di TSMC.



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