CoreLpc v2.0 è un nuovo core che rende disponibile un’interfaccia conforme alle specifiche Apb3 con il bus a ridotto numero di pin Lpc che è un sottoinsieme del bus Pci. Esso fornisce anche un’implementazione basata su Lpc dei registri dell’interfaccia Kcs definiti nelle specifiche dell’interfaccia Ipmi. I controllori per la gestione di piattaforme xTca basati sugli Fpga della serie Fusion che integrino CoreLpc possono comunicare con applicazioni conformi a Ipmi che girino sui corrispondenti processori di payload senza bisogno di apportare alcuna modifica alle stesse;
CorePwm v4.0 aggiunge la possibilità di misurare la frequenza dei segnali del contagiri di una ventola. Abbinata all’uscita in corrente modulata in modalità Pwm di questo blocco, la funzione di ingresso del contagiri consente la gestione della ventola ad anello chiuso, semplificando in tal modo l’implementazione di controllori di gestione di piattaforme xTca basate su Fusion per vassoi di ventole;
Core I2C v6.0 implementa un’interfaccia per I2C bus che comprende link per la gestione in-box basata su Ipmb. Questo core migliorato prevede anche il supporto per una configurazione multicanale al fine di ridurre il consumo di elementi nei progetti Fpga che contemplino numerose interfacce I2C. La realizzazione di canali I2C distinti per ciascuno slot AdvancedMC nelle schede carrier AdvancedTca e MicroTca contribuisce ad aumentare l’affidabilità e le prestazioni di questi link critici per la gestione in-box.
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